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【Xilinx】

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【Zynq】

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【开发工具与评估板】

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【 生态系统与中间件】

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【活动与其他】

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【硬件优化】

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【软件智能】

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Xilinx

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求助:ERROR:Place:864 - Incompatible IOB's are locked to the same bank 3 toeflsieasy 2274/0 2015-04-19 11:22:59
by toeflsieasy
如何选择合适的FPGA千兆位收发器? toeflsieasy 926/0 2015-04-19 11:21:26
by toeflsieasy
求助:关于应用笔记xapp224_data recovery toeflsieasy 1166/0 2015-04-19 11:20:00
by toeflsieasy
DSO “comparo”彰显先进的Smarter System SCOFEEL 973/0 2015-04-18 23:57:48
by SCOFEEL
回到未来:用图形化方法快速实现复杂的SoC设计 iamacb1 978/0 2015-04-18 23:53:21
by iamacb1
打造安全的嵌入式系统至关重要 iamacb1 838/0 2015-04-18 23:47:42
by iamacb1
关于V5器件差分接口的一些疑问? iamacb1 832/0 2015-04-18 23:46:42
by iamacb1
怎么申请 调试版本 以太网络license a6251356 777/0 2015-04-18 00:07:57
by a6251356
使用XILINX FPGA实现的SATA硬盘控制和高速存储 muzhen2000 928/0 2015-04-18 00:05:25
by muzhen2000
问题求助?Verilog例化ODDR2时报错 muzhen2000 1426/0 2015-04-17 23:25:16
by muzhen2000
lwip在xc3s700an上应用时只使用BRAM资源是否足够 muzhen2000 990/0 2015-04-17 23:24:17
by muzhen2000
[求助]Master and Slave R/W address problem .About the three of Processing System(P muzhen2000 1113/0 2015-04-17 23:22:43
by muzhen2000
怎么把用户逻辑V文件翻译成FPGA内部原件的V文件??? 2007zoz 930/0 2015-04-17 23:21:28
by 2007zoz
求助:关于EDK 下利用LWIP实现双网口 2007zoz 1070/0 2015-04-17 23:19:58
by 2007zoz
关于使用clocking wizard 的询问? 2007zoz 1177/0 2015-04-17 23:18:39
by 2007zoz
where can find the third part programmer qualified by xilinx liset 2007zoz 970/0 2015-04-17 23:17:35
by 2007zoz
Xilinx 推出全新的 FPGA 设计方法培训课程 2007zoz 856/0 2015-04-17 23:16:37
by 2007zoz
把握赛灵思FPGA中的主要时钟资源 (作者:Sharad Sinha 新加坡南洋理工大学博士生) 091217272 1460/0 2015-04-16 00:15:30
by 091217272
最新的vertex5 ug190中DCM、PLL的几个时序图难理解! 091217272 871/0 2015-04-16 00:14:26
by 091217272
请教如何正确给FPGA的输入时钟和输出时钟分配引脚 091217272 922/0 2015-04-16 00:13:38
by 091217272
关于比特流下载出错的​问题:Device IDCODE不正确,​全是0. abgh668 838/0 2015-04-16 00:12:29
by abgh668
Data2MEM:47 - Not all BitLanes in ADDRESS_SPACE abgh668 2783/0 2015-04-16 00:11:15
by abgh668
用spartan6实现SATA接口的试种恢复问题 abgh668 951/0 2015-04-16 00:05:11
by abgh668
如何正确使用FPGA的时钟资源 abgh668 838/0 2015-04-16 00:01:11
by abgh668
FPGA工程师手记:FPGA系统设计黄金法则 (转自OFweek电子工程网) tuozi241 980/0 2015-04-12 22:56:42
by tuozi241
V5输入信号怎么会被弄到IODELAY模块里过了一圈呢? tuozi241 977/0 2015-04-12 22:55:22
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EDK14.4 MicroBlaze如何从Flash启动? tuozi241 864/0 2015-04-12 22:54:40
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(求助)PLL输入时钟抖动,导致PLL不工作 tuozi241 911/0 2015-04-12 22:54:01
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用V7GTH的自驱动能力简化评估链路性能 tuozi241 1048/0 2015-04-12 22:53:19
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如何阻止综合工具综合掉相同的例化模块 tuozi241 834/0 2015-04-12 22:52:20
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【求助】硬件实现协议卸载 pengrui 950/0 2015-04-12 21:29:10
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一种多芯片串行收发器纠偏方法 pengrui 964/0 2015-04-12 21:26:57
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图中为XC95144XL,pin_locking capability指的是什么? pengrui 835/0 2015-04-12 21:25:29
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LWIP “Temac error interrupt: Rx fifo over run”,使用V5_TEMAC_IP打印信息报错求助? pengrui 1174/0 2015-04-12 21:24:36
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SFP+光模块接口设计调试优化方法 pengrui 1281/0 2015-04-12 21:23:55
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Xilinx专家秘笈分享连载- 1-15 zxzzy2009 1017/0 2015-04-12 21:22:43
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matlab下使用System generator出现undriven input port? "Error reported by S-function 's zxzzy2009 1719/0 2015-04-12 21:21:52
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Virtex5系列FPGA上电瞬间IO状态 zxzzy2009 884/0 2015-04-12 21:20:57
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simulink中打不开SysytemGenerator?返回错误Error evaluating 'OpenFcn' callback of Xilinx S zxzzy2009 2303/0 2015-04-12 21:20:17
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Xilinx与台积公司宣布:全线量产采用CoWoSTM技术的28nm All Programmable 3D IC系列 zxzzy2009 984/0 2015-04-12 21:19:14
by zxzzy2009
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