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如何连接待测试模块的内部信号到ILA观察?

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becoll
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最后登陆时间:2013-07-26 21:02:47

直达楼层
1# 发表于 2010-05-05 16:31:12

我用CORE Generator的方式分别生成了ICONVIOILA三个核,如下图所示:

右下角蓝色的A模块是我打算在线调试的模块。现在我想用VIO核提供A模块的端口信号,而用ILA核来观察A模块的内部信号。

我的理解是:新建一个顶层测试文件,分别例化ICONVIOILA三个核和待测试的模块A,然后作必要的信号映射。然而通过例化,对外可见的只有模块A的端口信号,我怎样才能将模块A的内部信号连接到ILA核进行观察呢?

 




关键词:如何    接待    测试    模块    内部    信号    观察    

酒舞至尊。

RE: 如何连接待测试模块的内部信号到ILA观察?

becoll
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2# 发表于 2010-05-05 16:41:47

以前用chipscope都是用Core Inserter的方式插入chipscope核的,可以通过下图所示的图形界面直接连接待观察的内部信号,现在想用VIO核,而VIO核不支持Core Inserter的方式,所以只好用CORE Generator的方式了,而这种方式需要自己修改HDL代码建立连接关系,所以就不知道怎样去连接待观察的内部信号了,向用过该方式的高手求助!!



酒舞至尊。

RE: 如何连接待测试模块的内部信号到ILA观察?

Jason_Zhang
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3# 发表于 2010-05-05 19:15:57

你把ICO、VIO和ILA实例化到A模块中,至少我之前都是这么做的


My Email : zldpublic@gmail.com。

RE: 如何连接待测试模块的内部信号到ILA观察?

becoll
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4# 发表于 2010-05-05 19:35:27
Jason_Zhang的原帖

你把ICO、VIO和ILA实例化到A模块中,至少我之前都是这么做的


谢谢!
我没这么用过,所以有点怀疑。
假设A模块有个输入是复位信号——nRST,我想将它设为VIO,例化的VIO核中信号ASYNC_OUT和它对应,那么我的A文件中应该添加如下语句:

nRST<=ASYNC_OUT; (VHDL)或
assign  nRST=ASYNC_OUT; (Verilog)
而nRST本身就是A模块的输入信号,所以我感觉在A模块中加上上面的语句有点不合适

我先试试看有没有问题吧,谢谢解答~


酒舞至尊。

RE: 如何连接待测试模块的内部信号到ILA观察?

Jason_Zhang
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5# 发表于 2010-05-05 23:06:13
Jason_Zhang的原帖

你把ICO、VIO和ILA实例化到A模块中,至少我之前都是这么做的

becoll的原帖
谢谢!
我没这么用过,所以有点怀疑。
假设A模块有个输入是复位信号——nRST,我想将它设为VIO,例化的VIO核中信号ASYNC_OUT和它对应,那么我的A文件中应该添加如下语句:

nRST<=ASYNC_OUT; (VHDL)或
assign  nRST=ASYNC_OUT; (Verilog)
而nRST本身就是A模块的输入信号,所以我感觉在A模块中加上上面的语句有点不合适

我先试试看有没有问题吧,谢谢解答~


VIO我没用过。
这样的话,就要把nRst先从端口去了才行吧

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RE: 如何连接待测试模块的内部信号到ILA观察?

becoll
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6# 发表于 2010-05-06 17:02:25
Jason_Zhang的原帖

你把ICO、VIO和ILA实例化到A模块中,至少我之前都是这么做的

becoll的原帖
谢谢!
我没这么用过,所以有点怀疑。
假设A模块有个输入是复位信号——nRST,我想将它设为VIO,例化的VIO核中信号ASYNC_OUT和它对应,那么我的A文件中应该添加如下语句:

nRST<=ASYNC_OUT; (VHDL)或
assign  nRST=ASYNC_OUT; (Verilog)
而nRST本身就是A模块的输入信号,所以我感觉在A模块中加上上面的语句有点不合适

我先试试看有没有问题吧,谢谢解答~

Jason_Zhang的原帖
VIO我没用过。
这样的话,就要把nRst先从端口去了才行吧

这样子确实可以,谢谢!
还想请教一下:用这种core generator的方式如何将ila中信号的重命名、进制显示方式等设置保存下来啊?每次重新设置挺麻烦的,没发现怎样存cdc文件,不知怎样操作?

酒舞至尊。

RE: 如何连接待测试模块的内部信号到ILA观察?

Jason_Zhang
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7# 发表于 2010-05-06 19:21:16

在Analizer中可以直接保存啊


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RE: 如何连接待测试模块的内部信号到ILA观察?

becoll
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8# 发表于 2010-05-07 09:31:05
Jason_Zhang的原帖

在Analizer中可以直接保存啊


不太明白,你是指下图所示的窗口吗?

用core insertor 方式使用chipscope时会自动产生一个cdc文件,使用analyser时直接将这个cdc文件import进来就行了,不知道你所说的直接存是存一个什么文件?是工程文件.prj么还是上图中所示的某种文件?
谢谢!

酒舞至尊。

RE: 如何连接待测试模块的内部信号到ILA观察?

Jason_Zhang
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9# 发表于 2010-05-07 10:24:32

在ChipScope Pro Analyzer中,File ---> save,保存为cpj格式就可以了


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RE: 如何连接待测试模块的内部信号到ILA观察?

becoll
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10# 发表于 2010-05-07 20:15:35
Jason_Zhang的原帖

在ChipScope Pro Analyzer中,File ---> save,保存为cpj格式就可以了


多谢啊!受核插入法的影响,头脑没转过弯来,呵呵!

酒舞至尊。

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