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版主: 51FPGA

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将 DDR SDRAM 与 CoolRunner-II CPLD 接口

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Rancho
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最后登陆时间：2015-01-14 09:17:39
直达楼层
1# 发表于 2012-05-13 09:52:30

本技术文档介绍了 CoolRunner™-II CPLD 与双倍数据速率 (DDR) SDRAM 存储器器件接口的参考设计。 创建的参考设计能够在 100 MHz 的工作频率下运行。

xapp384.pdf




关键词：SDRAM    CoolRunner-II    接口    

Rancho。
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