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xilinx fifo ip核 empty信号出错 求指导
版主: 51FPGA
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xilinx fifo ip核 empty信号出错 求指导
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scw0220
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2015-01-13 22:03:44
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发表于
2015-08-01 23:57:52
如图可见 数据已经送进去了,但是empty信号不在第一个数读入时变低,过了好几个数才变低,请问这是哪里出现问题了,谢谢大家
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