版主: 51FPGA
最后登陆时间:2015-03-19 10:58:07
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视频标题
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Xilinx高级副总裁Victor Peng带您了解 UltraScale 架构
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Vivado DRC(设计规则检查)概述
Vivado IP 约束介绍
OmniTek 超清 HDTV 图像处理方案演示
使用 Zynq SoC 实现计算机视频实时算法
ISD netSeries 视频监控摄像头方案演示
解放双手:基于Zynq SoC的EyeTech眼球跟踪系统演示
UltraFast:高效的Vivado设计方法教程
【中文视频】针对Vivado设计套件的高效设计方法——UltraFast
【中文视频】XILINX推出All Programmable抽象化计划,加快开发速度达15倍
如何在Vivado中使用 ”JTAG to AXI Master“ 功能
在 Xilinx 7 系列 FPGA 实现 Intel QPI 协议
Xilinx Zynq-7000 AP SoC ZC702 评估套件演示
Vivado HLS 简介
Virtex-7 FPGA VC709 连接套件演示
10GBASE-KR 与 Virtex®-7 FPGAs 的电气一致性
XILINX与ARM:Zynq-7000 All Programmable SoC
XILINX与ARM:定位一个全新市场
XILINX推出All Programmable抽象化计划,加快开发速度达15倍
XILINX 7系列 10G Base-KR背板解决方案
如何在XILINX SDK中进行异构多核调试
如何使用Vivado消息管理器