ip core 中dds 怎么用？

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直达楼层
1^# 发表于 2011-05-06 21:38:48

如题，刚在看ip core，中的dds，看的一头雾水。
想问问这里的大牛们，core中的a，和data，是怎么用的？
传的数是怎么算出来的？特别是data的数，怎么算的啊。我总觉得书上说的，少了很多东西。·····
不像加法core那样简单啊，

关键词：怎么

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2^# 发表于 2011-05-08 10:48:17

dreamjsc的原帖

你用的是Xilinx的DDS么？
DDS首先是一个相位累加器，输出的相位去寻址Sine/Cosine查找表！
Xilinx的DDS与相位相关的输入有两个：PINC与POFF，而输入的模式有三种：fixed,programmabe,streaming，并且还可以多通道输出。
你上面说的a，应该是指ADDR吧，ADDR在多通道输出且输入模式为programmabe时才使用！用于指示PINC与POFF是写的哪个通道的！
而DATA也是在输入模式为programmabe时才使用，DATA的值是PINC或POFF的值，具体是PINC还是POFF由REG_SELECT决定！

另外，Xilinx每个IP都有详细的datasheet，在使用IP之前最好阅读一下，你要的东西都可以在datasheet中找到！

我知道是怎么算data，知道A大多都设成0.但是我不知道是什么时候给data传数，和给a传数啊？我看的一些程序上面都是直接调用了。没有给data和a传数啊？
另外我用的是xilinx的ise。

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此贴由只为吸引你于2011-05-08 10:52:18最后编辑

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3^# 发表于 2011-05-08 19:24:13

dreamjsc的原帖

当不需要多通道输出时，不需要给ADDR传数！
当输入模式不为programmable时，不需要给DATA传数！

那我就不明白了，那它输出的载波频率怎么确定啊？

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4^# 发表于 2011-05-09 12:11:22

dreamjsc的原帖

当不需要多通道输出时，不需要给ADDR传数！
当输入模式不为programmable时，不需要给DATA传数！

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那我就不明白了，那它输出的载波频率怎么确定啊？

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载波频率由CLK与PINC决定的！PINC为每个时钟的相位增加值！看一下datasheet的时序图你就明白了！

可能是你没明白我意思，要不就是我太笨了

，比如这个程序。
在使用时，直接调用mydds模块即可，如

module dds1(DATA, WE, A, CLK, SINE, COSINE);
input [27 : 0] DATA; //经过计算，DATA= 10737418.
input WE;
input [4 : 0] A;
input CLK;
output [9 : 0] SINE;
output [9 : 0] COSINE;

mydds mydds1(
.DATA(DATA),
.WE(WE),
.A(A),
.CLK(CLK),
.SINE(SINE),
.COSINE(COSINE)
);

endmodule
为什么就写了，经计算data=10737418，直接调用就可以了，而不给data传数呢？是不是在生成IP核时就定义好data了？还是还要在写个其他的程序给data和we这些传数呢？我瞟了一眼时序图，但还是不理解······

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5^# 发表于 2011-05-09 16:54:30

dreamjsc的原帖

你使用的ISE是哪个版本？
我用的ISE12.1,使用的DDS Compiler4.0,没有A这个端口，只有ADDR这个端口。ADDR是用于DDS多通道的输出。且最多16个通道，所以位宽最大只有4位，而你的A位宽有5位，所以可能我们用的ISE版本不同！你的DDS中的A端口是用来做什么的？

另外，生成DDS IP时有很多选项，要根据自己的设计要求选择合适的模式!

你使用DDS是输出一个固定不变的频率还是频率需要改变？是否有调制？

如果输出频率固定且不需要可编程，在DDS Compiler4.0生成DDS时，不需要DATA这个端口！

我的这个ise是9.2i的版本，A端口和你的addr是同一个意思的，A的低四位选输出通道的，最高的一位是选择相位偏置寄存器（1）/相位增量寄存器（0）的。我是想让这个DDS作为VCO或者NCO的。所以data肯定要变的哇。求指导···呵呵

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6^# 发表于 2011-05-09 22:00:54

dreamjsc的原帖

这样就清楚多了！首先你应该是单通道输出，所以A的低4位一直为零！你只是想输出一个频率，则相位偏置寄存器也可以不管！所以A的最高位可以一直为零，即一直指向相位增量寄存器！至于DATA在什么时候送数，取决于你什么时候频率需要改变！当频率需要改变时，算出来的DATA值也要改变，就需要更新相位寄存器的值！这时送数就行了！送数的控制信号可以用WE！

,大牛啊，你没明白我的意思哈，你看到我上边写的那个程序了吗？我是想问啊，那个data怎么给它送数？
就是我知道了它是多少，也知道什么时候要改变输出频率，但是我的“data<=10737418；”这句话，应该写在什么地方呢？顶端那个模块中也没有data<=10737418”这句话啊。难道在其他的什么模块中吗？
ps：感谢你这么不厌其烦的给我解答。3q哈。
另外你的12.0的版本是从什么地方下的啊，给个地址呗，还有注册的key哈，我的这个不知道是不是太老了还是怎么的了，在生成滤波器时（fir compiler）总是出现“0x60010440指令引用的0x00000000内存，该内存不能为read”这句话，然后我点了确定后，ip core的生成过程就中断了。

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7^# 发表于 2011-05-10 19:51:16

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你现在生成的只是一个DDS模块，当然需要写一个控制DDS输出的模块！在控制模块中把WE与DATA的时序写好！

你程序中dds1模块是没有任何意义的，因为它完全等同于mydds模块，所以你可以把控制模块写在dds1中！

呵呵，终于明白了，这么大的事，书上竟然只字未提，真是气人。
另外在问句，如果用dds做固定频率的载波发生器的话（就是没用data），是不是也就不用加那个控制模块了啊？

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8^# 发表于 2011-05-20 21:13:21

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固定频率有两种：第一种是生成IP时，频率就固定，即频率是不可重配置的，这样的话可以不要控制模块；第二种是频率是可编程的，即上电只配置一次频率，之后保持不变，这样的话仍需要控制模块！

恩，谢谢。隔了一周啦，有些事情耽误了，没看到。
我想问问是不是第一种频率固定啦，是不是等于那个ip core的输入频率啊？不然那个频率控制字都没有啊，呵呵。还有我怎么忘了，频率的控制字k是怎么算的了，？真晕，那个2的n次幂，中的n是不是就是输出cosine或者sine中的【n-1，·····，0】的n个啊？
书上说假如，工作时钟为100m，输出个分辨率为0.1hz的，4mhz的波形！怎么算来算去，k=10737418呢？我怎么算也不是啊！输出的sine是10位的！

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9^# 发表于 2011-05-21 22:04:08

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第一种频率固定，在生成IP时就需要选择输出频率，根据输出频率和时钟频率，软件会自动算出频率控制字！

2的n次方中的n是指相位累加器的宽度！输出sine的位宽是幅度上的量化，与相位（频率）无关！

恩，知道啦。但是我不是那样算的。
你看啊，频率分辨率是0.1HZ，那么系统工作f_clk/2ⁿ=0.1hz吧。我把0.1hz直接带入到f_out=f_clk×k/2ⁿ中，k=40×10⁶啊。这是为什么啊，·····唉？

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10^# 发表于 2011-05-22 19:59:50

dreamjsc的原帖

能把你的运算过程描述得再清楚点不？

恩，
频率分辨率为0.1HZ吧，要求输出的f_out=4MHZ。f_clk=100MHZ。
根据公式频率分辨率f=f_clk/2ⁿ。知道2ⁿ=100MHZ/0.1HZ=1000×10⁶.
然后在根据公式：4M=f_clk×K/2ⁿ。算出K=40×10⁶.这么算错在什么地方了啊？呵呵

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