SystemVerilog高手看过来。怎样将generate语句产生的一组interface传到program里。

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直达楼层
1^# 发表于 2015-07-31 23:23:27

假设我有一组interface，数量由parameter spi_count决定。在顶层是这样例化的：

CODE:

genvar i; generate for (i=0;i<spi_count;i++) begin:gen spi_interface spi_if (.clk(clk)); end endinterface现在有两个问题 1）我想把这一组spi_if全都传到一个program里去，请问program里该怎么写？ 2）我想访问某个spi_if内部的东西，该怎样写？试了下，直接明确地写数字gen[0].spi_if.xxx是可以的，但是如果使用一个变量gen[k].spi_if.xxx就不认。

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